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EPM240T100C5特点
在MAX II CPLD的具有以下特点：
低成本，低功耗CPLD
即时启动，非易失性建筑
待机电流低至29？阿
提供快速传播延迟和时钟到输出时间
提供四个，每两个时钟逻辑阵列块可用（实验室）全局时钟
的UFM块最多8 Kbits的非易失性存储
核心的MultiVolt有利的外部电源电压为3.3 V/2.5任一器件的V
或1.8 V
的MultiVolt I / O接口，支持3.3伏，2.5伏，1.8 V和1.5 V逻辑电平
巴士友好架构，包括可编程摆率，驱动强度，总线
持有和可编程上拉电阻
施密特触发器输入使能耐噪音（每管脚可编程）
I / O是完全符合外围组件互连特别
兴趣小组（PCI SIG）的PCI本地总线规范2.2修订为3.3 - V的
在66兆赫操作
支持热插拔
内置联合测试行动组（JTAG）边界扫描测试（英国夏令）电路
符合IEEE标准。 1149.1-1990
ISP的电路与IEEE标准兼容。 1532
