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特点MAX ll CPLD具有以下特点:低成本,低功耗CPLD瞬时上电,非易失性建筑standbycurrent as low as 29 UA提供快速的传播延迟和时钟输出时间提供4个全局时钟,每两个时钟逻辑陈列模块(LAB) UFM堵塞8 Kbist的非易失性储存MultiVolt核心,使外部的电源电压为3.3 V/2.5 V的装置的或1.8VMultiVolt/O接口,支持3.3-V,2.5-V,1.8-V,1.5-V的逻辑电平总线型结构,其中包括可编程摆率,驱动强度,总线举行,可编程的上拉电阻施密特触发器使噪声容限输入(可编程每针)l / o是完全兼容的外围组件互联特别兴趣小组(PCl SlG),PCl本地总线规范,2.2版,3.3-V运行在66 MHZ 支持热插拔,内置的联合测试行动组(JTAG) 边界扫描测试(BST) 电路符合lEEE标准。1149.1-1990lSP电路与lEEE标准兼容.1532